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[자연과학] 전기전자 test(실험) 보고서 - LR회로 test(실험) 보고서

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작성일 24-08-14 06:54

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유도 시간 상수는 전류가 그 최대치의 63%까지 증가하는 데 걸린 시간(혹은 최대치의 37%까지 떨어지는데 걸린 시간)이다. 하지만 그래프를 보면 전압차이가 나는 것을 볼 수 있습니다. 전류는 지수적으로 증가할 것이고 이는 다음과 같다.이 부분에서 무엇인가 감소를 이루게 되어 이 부분은 어떤것이 작용했다는 것인데 이것 때문에 전압의 총합이 항상 같지 않을수 있다고 생각합니다.시간 가 된 후에, 지속적인 상태의 전류 가 성립되고 저항기를 거친 전압은 적용 된 전압 과 …(省略)

1. 바나나 플러그 패치 코드를 interface의 출력 포트에 연결한다. 유도 시간 상수는 전류가 성립되는데 걸리는 시간의 측정(測定) 치이다.

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실험과제/기타

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LR회로
실험목적 및 배경理論
理論:DC 전압이 병렬의 유도기와 저항기에 적용될 때, 안정된 상태의 전류는 다음과 같이 성립될 것이다.그래프를 보면 왼쪽 위에를 보면 살짝 곡선으로 이루어진 것을 발견할수 있습니다.
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다. 전류가 최대치의 반까지 증가하거나 감소하는데 걸린 시간은 다음과 같은 식에 의한 유도 시간 상수와 관련이 있다 저항기를 거친 전압이 로 주어지기 때문에, 저항기를 거친 전압은 지수적으로 증가하게 된다 유도기를 거친 전압은 다음과 같고 , 유도기를 거친 전압은 그 최대치에서 처음 하여 지수적으로 감소한다.
여기에서 은 유도상수와 그 양이고 은 유도 시간 상수이다.2. p51.LR Circuit 파일을 연다.

2.kirchhoff의 Loop 규칙은 항상 지켜지는가 그래프를 사용하여 적어도 세 번은 이를 확인하라. 저항기와 유도기를 거치는 전압의 총합은 어느 때나 전압원과 같은가 kirchhoff의 루프 법칙은 전압 change(변화)의 합은 0을 나타냅니다.4. 설정 값을 3V, 5Hz로 Sample Rate 10,000Hz로 맞춘다.Imax=V0/R 여기에서 는 적용된 전압이고 은 회로에서의 총 저항이다. 그러나 유도기가 전류의 증가에 reaction 하여 반대의 emf를 발생하기 때문에 이러한 안정된 상태의 전류를 만드는 데에는 시간이 걸린다.3. 회로를 꾸민 후, 저항과 다이오드를 연결한다.

REPORT 11(sv76)


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